高朝輝++呂芝偉

摘 要：隨著數(shù)字時代在不斷的更新，數(shù)字陣列雷達(dá)已經(jīng)成為相控陣?yán)走_(dá)的重要發(fā)展方向。因此，在數(shù)字陣列中數(shù)字收發(fā)組件式數(shù)字陣列雷達(dá)最重要的核心。在數(shù)字陣列中，由于雷達(dá)DAM模塊的數(shù)量比較多。因此，數(shù)字陣列通常與陣列天線集成了安裝在艙外導(dǎo)致調(diào)試?yán)щy的實(shí)際情況，在這種數(shù)字列陣中主要是利用Flash存儲配置數(shù)據(jù)、CPLD產(chǎn)生配置時序和通信接口、復(fù)用系統(tǒng)通信光纖，來收發(fā)組件現(xiàn)場可編程門陣列遠(yuǎn)程配置的設(shè)計方法。將數(shù)字陣列收發(fā)組件FPGA遠(yuǎn)程配置來解決DAM模塊遠(yuǎn)程調(diào)試的難題，在技術(shù)的應(yīng)用中極大的提高了系統(tǒng)的試驗(yàn)效率。并且通過數(shù)字雷達(dá)陣列來進(jìn)行具體的驗(yàn)證，從中得到良好的效果。

關(guān)鍵詞：數(shù)字陣列 收發(fā)組件 FPGA遠(yuǎn)配置

中圖分類號：TN95 文獻(xiàn)標(biāo)識碼：A 文章編號：1672-3791（2014）03（a）-0025-01

在數(shù)字時代變化中，已經(jīng)實(shí)現(xiàn)了對數(shù)字列陣?yán)走_(dá)的工程化應(yīng)用，在使用中數(shù)字陣列雷達(dá)可以進(jìn)行動態(tài)的監(jiān)測、以及在使用中具有多波束、低損耗、低副瓣的有點(diǎn)，因此在工程研究所以及科研機(jī)構(gòu)中，對相控陣?yán)走_(dá)的研究有著重要的指導(dǎo)意義。

1 數(shù)字陣列雷達(dá)

數(shù)字陣列雷達(dá)是由天線陣列、數(shù)字T/R組件、時鐘、數(shù)據(jù)的傳輸系統(tǒng)以及數(shù)字處理機(jī)共同組成的，在通信技術(shù)的使用中，雷達(dá)陣列有幾十個甚至幾百個數(shù)字T/R組件，在這些組件中，基本上是由模塊通過光纖與數(shù)字處理機(jī)高速數(shù)據(jù)完成通信的具體過程。但是在雷達(dá)組件中，這些組件的模塊基本上是同天線陣列集成設(shè)計然后構(gòu)成了有源陣列的天線。在雷達(dá)裝置中通常是安裝在室外，這就為工作人員的調(diào)試造成了困難，因此，在本文對數(shù)字陣列收發(fā)組件FPGA遠(yuǎn)程配置中，主要是利用Fiash存儲配置數(shù)據(jù)、CPLD產(chǎn)生配置時序和通信接口、復(fù)用裝機(jī)通信光纖，這樣最終能夠在艙內(nèi)實(shí)現(xiàn)了DAM模塊中FPGA遠(yuǎn)程加載以及動態(tài)重構(gòu)的設(shè)計，這種遠(yuǎn)程組件大大的提高了系統(tǒng)的可調(diào)式性，提高了工程的使用效率，并且縮短了工程的周期。

2 數(shù)字陣列收發(fā)組件的需求分析以及系統(tǒng)構(gòu)建

2.1 FPGA期器件的具體配置

在研究FPGA器件中，本文主要通過Altera公司生產(chǎn)的StratixII系列的FPGA組件為例，分析了FPGA器件中的具體配件，它主要支持被動串行、主動串行、快速被動串行、被動異步并行以及JTA這五中具體的方式。在FPGA配置中，主要是將配置數(shù)據(jù)存儲在SRAM中，然后愛進(jìn)行易失性要求FPGA每次在進(jìn)行加電的時候，需要進(jìn)行重新的加載配置數(shù)據(jù)。其中該配置主要是由MSEL[3..0]來決定具體的配置方式，以及接地的信號。

2.2 遠(yuǎn)程配置的硬件構(gòu)建

在數(shù)字陣列收發(fā)組件中FPGA的遠(yuǎn)程配置過程中，遠(yuǎn)程配置功能與系統(tǒng)功能進(jìn)行一體化的設(shè)計，然后不斷的增加系統(tǒng)規(guī)模以及成本，最終來提高組件的系統(tǒng)中的可測性以及可調(diào)試性。然而在系統(tǒng)中DAM模塊在進(jìn)行設(shè)備的自檢、分系統(tǒng)自檢以及正常的工作狀態(tài)中，為FPGA加載不同的配置數(shù)據(jù)，另外在Flash存儲器中需要加載更多的技術(shù)，最終實(shí)現(xiàn)DAM模塊的重構(gòu)以及不同的設(shè)計。提高在使用中的試驗(yàn)效率，擴(kuò)充系統(tǒng)的使用功能。然而在綜合容量需求、工作電壓、配置速度等要求中，F(xiàn)lash存儲器的高4位地址為每套配置數(shù)據(jù)的索引地質(zhì)，并且單片的Flash實(shí)際加載的16套配置數(shù)據(jù)。在FPGA的硬件配置時序、Flash存儲器的讀寫控制、配置數(shù)據(jù)的獲取以及校驗(yàn)中是通過CPLD來完成的，并且該裝置不需要專用配置芯片，采用的是單電源進(jìn)行供電，在光/電串口中轉(zhuǎn)化為遠(yuǎn)程加載調(diào)試專用設(shè)備，它主要是由光收發(fā)模塊以及芯片構(gòu)成，最終實(shí)現(xiàn)了計算機(jī)RS232串口信號與光信號的雙向轉(zhuǎn)換。能夠在遠(yuǎn)程裝置中加強(qiáng)硬件的使用效率，實(shí)現(xiàn)了最優(yōu)化的遠(yuǎn)程加載組件。

FPGA遠(yuǎn)程配置的工作原理：在數(shù)字陣列收發(fā)組件中，該設(shè)備在進(jìn)行加電工作中，最初是正常加載模式，并且實(shí)行了加載正常工作時序。在通過控制時序、讀取配置數(shù)據(jù)以及將配置數(shù)據(jù)寫入具體的器件過程中，通過檢測配置完成的信號，以及完成對初始化信號，最終判斷FPGA是否配置成功。在組建進(jìn)行遠(yuǎn)程加載的過程中，通常是對DAM模塊直接接入通信光纖中，對串口光/電轉(zhuǎn)換模塊，最終實(shí)現(xiàn)調(diào)試計算機(jī)與CPLD控制器的雙向數(shù)據(jù)通信。將CPLD控制器接收到的配置數(shù)據(jù)存儲與Flash相應(yīng)的空間地址，然后將數(shù)據(jù)進(jìn)行上傳，存入Flash存儲器。完成配置管理軟件的發(fā)送以及進(jìn)行動態(tài)重構(gòu)，最終啟動新的配置時序，完成正常的遠(yuǎn)程加載。

3 軟件時序設(shè)計

在軟件時序設(shè)計中，最重要的是對配置的數(shù)據(jù)進(jìn)行獲取與存儲、FPGA配置時序設(shè)計以及配置管理軟件的具體設(shè)計。然而在對配置的數(shù)據(jù)進(jìn)行獲取與存儲中，將CPLD內(nèi)嵌UART串口收發(fā)軟核，然后通過模塊之間的轉(zhuǎn)換以及調(diào)試計算機(jī)進(jìn)行雙向數(shù)據(jù)的通信，最終獲取配置數(shù)據(jù)文件，并且將存儲的數(shù)據(jù)放入Flash中..FPGA配置時序設(shè)計環(huán)節(jié)中，將配置數(shù)據(jù)加載中，需要在設(shè)計過程中進(jìn)行實(shí)時監(jiān)測，注重對信號的加載。最后在配置管理軟件設(shè)計中，主要是通過對計算機(jī)的調(diào)試來完成的，配置管理軟件主要應(yīng)用在管理上傳、讀取配置數(shù)據(jù)文件以及完成數(shù)據(jù)通信等。

4 結(jié)語

通過對數(shù)字陣列雷達(dá)工程進(jìn)行具體的分析，并且結(jié)合DAM模塊與FPGA組件遠(yuǎn)程配置以及動態(tài)重構(gòu)的具體設(shè)計以及軟件的要求進(jìn)行研究，能夠處理好系統(tǒng)內(nèi)部的通信光纖，并且解決了DAM模塊遠(yuǎn)程調(diào)試。最終實(shí)現(xiàn)了動態(tài)重構(gòu)以及自動檢測。因此，在數(shù)字陣列收發(fā)組件中FPGA遠(yuǎn)程裝置提高了系統(tǒng)內(nèi)部的使用效率。完成了串口通信以及信號確認(rèn)，以及在信號的轉(zhuǎn)化中實(shí)現(xiàn)了遠(yuǎn)程加載，以及對信號實(shí)施了動態(tài)監(jiān)測。該技術(shù)提高了我國通信網(wǎng)絡(luò)技術(shù)的應(yīng)用。

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