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        基于FPGA的Viterbi算法改進(jìn)及其實現(xiàn)

        2011-12-30 07:47:08朱磊基汪涵施玉松邢濤王營冠
        現(xiàn)代電子技術(shù) 2011年15期
        關(guān)鍵詞:吞吐量改進(jìn)

        朱磊基 汪涵 施玉松 邢濤 王營冠

        摘 要:為了在不改變譯碼效果的條件下,達(dá)到提高譯碼器的譯碼速度的目的,對傳統(tǒng)的Viterbi算法的實現(xiàn)方法提出了兩點改進(jìn):簡化分支度量計算和復(fù)用加比選單元分組。FPGA實現(xiàn)以后顯示,在獲得同等譯碼性能的條件下,新的實現(xiàn)結(jié)構(gòu)比改進(jìn)前僅僅多耗費了可以忽略的資源,卻可以達(dá)到接近原結(jié)構(gòu)3倍的吞吐量和接近2倍的最大系統(tǒng)工作頻率。

        關(guān)鍵詞:Viterbi; 改進(jìn); 吞吐量; 最大工作頻率

        中圖分類號:TN957.52-34 文獻(xiàn)標(biāo)識碼:A 文章編號:1004-373X(2011)15-0082-03

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