謝秀峰，蘇淑靖

(中北大學(xué)電子測(cè)試技術(shù)重點(diǎn)實(shí)驗(yàn)室，太原030051)

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基于FPGA的通用PCM接收解碼電路的設(shè)計(jì)

謝秀峰，蘇淑靖*

(中北大學(xué)電子測(cè)試技術(shù)重點(diǎn)實(shí)驗(yàn)室，太原030051)

摘要:為了準(zhǔn)確接收提取某遙測(cè)系統(tǒng)的PCM數(shù)據(jù)，設(shè)計(jì)了基于FPGA的通用PCM接收解碼電路，該電路通過基于鎖相環(huán)的位同步器實(shí)現(xiàn)不同碼率的PCM數(shù)據(jù)流接收，通過三態(tài)搜索理論的幀同步器可判別不同幀結(jié)構(gòu)數(shù)據(jù)，碼型轉(zhuǎn)換模塊識(shí)別并轉(zhuǎn)換NRZ-L/M/S、BiФ-L/M/S 6種碼型，最后電路將解調(diào)出的數(shù)據(jù)通過USB接口傳送至計(jì)算機(jī)進(jìn)行存儲(chǔ)、顯示和處理。該電路可識(shí)別碼型不同、碼速率不同以及幀同步碼組不同的PCM數(shù)據(jù)流，兼有單端和差分輸入接口，在遙測(cè)領(lǐng)域具有很強(qiáng)的通用性。關(guān)鍵詞:PCM; FPGA;通用;位同步;幀同步

脈沖編碼調(diào)制(PCM)是一種將模擬信號(hào)轉(zhuǎn)換為數(shù)字信號(hào)的基本方法，目前，它不僅用于通信領(lǐng)域，還廣泛應(yīng)用于計(jì)算機(jī)、數(shù)字儀表、遙控遙測(cè)等許多領(lǐng)域。而高速遙測(cè)PCM數(shù)據(jù)是遙測(cè)系統(tǒng)測(cè)量衛(wèi)星、航天器及武器系統(tǒng)等內(nèi)外部的環(huán)境參數(shù)［1－2］，地面計(jì)算機(jī)通過被測(cè)目標(biāo)傳回的數(shù)據(jù)，確定其工作狀態(tài)以及各項(xiàng)性能。為了彌補(bǔ)目前遙測(cè)接收裝置只能讀取參數(shù)固定、碼型單一以及碼率不變的PCM技術(shù)的不足，本文設(shè)計(jì)了基于FPGA的通用PCM接收解碼電路，其中可靠的同步技術(shù)是實(shí)現(xiàn)數(shù)據(jù)準(zhǔn)確接收的關(guān)鍵，該電路以Xilinx公司的Spartan3E系列FPGA芯片XC3S500E為核心，采用基于鎖相環(huán)的精確位同步和基于三態(tài)搜索的雙重校驗(yàn)判決幀同步方法，實(shí)現(xiàn)PCM碼速率為1 Mbit/s～10 Mbit/s的可靠接收，并可對(duì)NRZ-L/M/S、BiФ-L/M/S 6種碼型解碼且無誤碼，可判別EB 90H和9A BC B5 2CH這兩個(gè)常用幀同步碼組，以上特點(diǎn)不僅滿足了當(dāng)前使用的背景要求，而且可應(yīng)用于其他PCM通信領(lǐng)域。

1　總體設(shè)計(jì)方案

不同的場(chǎng)合所用的PCM數(shù)據(jù)流屬性不同，為滿足不同的場(chǎng)合的應(yīng)用需求，設(shè)計(jì)了本通用接收解碼電路，其總體方案如圖1所示。其中接收解碼電路主要由輸入接口模塊、FPGA邏輯控制模塊及USB接口通信模塊3部分組成，其中FPGA的功能包括位同步、碼型轉(zhuǎn)換、幀同步以及全局的邏輯控制和時(shí)序控制?？傮w工作流程為:通過單端或差分接口輸入的PCM碼流先經(jīng)過位同步器實(shí)現(xiàn)不同碼速率的精確位同步，并從中提取出數(shù)據(jù)流的時(shí)鐘信息，經(jīng)過碼型轉(zhuǎn)換的數(shù)據(jù)接著通過幀同步器確定其內(nèi)容中的幀格式實(shí)現(xiàn)幀同步，在幀同步后將解碼得到的有效數(shù)據(jù)打包并上傳至計(jì)算機(jī)進(jìn)行分析及處理。

圖1　總體方案框圖

2　FPGA模塊設(shè)計(jì)

2.1位同步器

位同步是正確解碼的基礎(chǔ)，只有正確取得位同步之后，才能實(shí)現(xiàn)幀同步。位同步器主要功能是通過精確調(diào)整使得位同步脈沖與輸入PCM碼流實(shí)現(xiàn)同頻同相，并輸出定時(shí)脈沖序列［3］。

本文采用直接位同步數(shù)字鎖相環(huán)方法實(shí)現(xiàn)位同步器設(shè)計(jì)。位同步器由時(shí)鐘源、分頻器、鑒相器、數(shù)字濾波器和控制器所組成，控制器又包括“或門”、附加門和扣除門(如圖2)。時(shí)鐘源為高穩(wěn)定晶振，分頻器采用直接數(shù)字頻率合成技術(shù)產(chǎn)生1 MHz～10 MHz的時(shí)鐘脈沖［4－5］，這樣在收到計(jì)算機(jī)下發(fā)的PCM碼速率的頻率控制字后，分頻器就能產(chǎn)生對(duì)應(yīng)的時(shí)鐘脈沖來匹配不同碼速率的PCM碼流。由于噪聲的存在和信道干擾，使接收碼元產(chǎn)生抖動(dòng)，每個(gè)碼元的邊沿幅度抖動(dòng)是造成碼元相位判斷誤差的直接原因，所以需要對(duì)輸入的數(shù)字信號(hào)經(jīng)過數(shù)字濾波器濾波，以利于對(duì)整個(gè)碼元周期的判定。

圖2　位同步器原理組成

位同步器工作原理如下:假設(shè)接收到的PCM碼率為f0，時(shí)鐘源輸出的時(shí)鐘信號(hào)經(jīng)分頻器分頻后，再通過扣除門和或門，得到的位同步信號(hào)頻率為f0，如果不能和收到的碼元精確同頻同相，就需要參考鑒相器輸出的判斷信號(hào)，通過控制器進(jìn)行適當(dāng)調(diào)整。當(dāng)位同步脈沖比輸入碼元的相位超前時(shí)，鑒相器輸出一個(gè)超前脈沖到扣除門(常開)扣除一個(gè)a路脈沖，使位同步脈沖的相位推遲1/n周期(2π/n);若分頻器輸出的位同步脈沖相位比輸入碼元的相位滯后，那么加于附加門(附加門常閉)的b路脈沖序列就會(huì)同時(shí)輸出一個(gè)脈沖通過“或門”，由于b路與a路相位相差π，所以這個(gè)脈沖會(huì)插入在原a路脈沖中間，分頻器就提前了1/n周期的相位輸出。如此反復(fù)幾次，輸出的位同步脈沖就與PCM碼流同頻同相，即可被幀同步器用作時(shí)鐘。

2.2碼型轉(zhuǎn)換

位同步后需要將不同碼型的數(shù)據(jù)轉(zhuǎn)換為NRZ－L碼，這樣可減小幀同步的資源占用，碼型轉(zhuǎn)換的原理如下:

設(shè)pcm_n為當(dāng)前輸入，pcm_pre為前一個(gè)輸入，pcm_out為轉(zhuǎn)換后的輸出，對(duì)于NRZ－M:

對(duì)于NRZ－S:

而對(duì)于BIΦ碼則需要先以原碼率的二倍速率取得對(duì)應(yīng)值，以此判斷出碼元的正確起始位置，然后再根據(jù)相應(yīng)規(guī)則轉(zhuǎn)換碼型，轉(zhuǎn)換公式分別如下:

BiΦ－L:pcm_out=pcm_in(3)

BiΦ－M:pcm_out=pcm_in XOR pcm_pre(4)

BiΦ－S:pcm_out=pcm_in XNOR pcm_pre (5)

圖3為NRZ－L的數(shù)據(jù)為101100011010的各種碼型的轉(zhuǎn)換結(jié)果。

圖3　碼型轉(zhuǎn)換圖

2.3幀同步器

幀同步器的功能是從位同步器輸出的PCM串行數(shù)據(jù)流中提取出幀同步碼組，產(chǎn)生幀同步信號(hào)，從而完成數(shù)據(jù)分離。為了實(shí)現(xiàn)幀同步，發(fā)送端在數(shù)字信息流中插入一些特殊碼組作為每幀的頭尾標(biāo)記，幀同步器需要準(zhǔn)確無誤的判斷出這些碼組，以確定幀結(jié)構(gòu)［5－6］。目前較常用的同步碼組主要有兩組，一組是副幀標(biāo)志為EB 90H，幀結(jié)束標(biāo)志為14 6FH［7］，另一組是9A BC B5 2CH與65 43 4A D3H的配合使用。在本設(shè)計(jì)中，幀同步器可根據(jù)參數(shù)配置模塊下發(fā)的同步碼組參數(shù)來選擇對(duì)應(yīng)碼組進(jìn)行幀同步。

幀同步器各功能模塊主要有:參數(shù)配置模塊，相關(guān)檢測(cè)模塊，幀同步狀態(tài)控制模塊和輸出控制模塊，其工作原理圖如圖4所示。

圖4　幀同步原理圖

幀同步器首先從計(jì)算機(jī)接收幀結(jié)構(gòu)參數(shù)，由參數(shù)配置模塊完成各參數(shù)配置，包括幀同步碼組、幀長(zhǎng)、同步容差和同步保護(hù)參數(shù)。然后當(dāng)檢測(cè)到串行數(shù)據(jù)流輸入時(shí)，相關(guān)檢測(cè)器進(jìn)行相關(guān)運(yùn)算，檢測(cè)是否有同步碼組出現(xiàn)，并將檢測(cè)值實(shí)時(shí)送至同步判決電路;同步判決模塊根據(jù)檢測(cè)值完成對(duì)同步狀態(tài)的控制，同步狀態(tài)有搜索、校驗(yàn)、鎖定3種狀態(tài)，當(dāng)狀態(tài)機(jī)進(jìn)入鎖定態(tài)時(shí)，表示達(dá)到幀同步，輸出幀同步信號(hào);最后，輸出控制模塊在幀同步信號(hào)的控制下，將串行數(shù)據(jù)轉(zhuǎn)換為并行數(shù)據(jù)和附帶時(shí)鐘信號(hào)一并輸出，完成數(shù)據(jù)的提取。

同步判決模塊的主體為一個(gè)狀態(tài)機(jī)，它根據(jù)相關(guān)檢測(cè)器的檢測(cè)值控制狀態(tài)機(jī)的狀態(tài)轉(zhuǎn)換，并控制產(chǎn)生幀同步信號(hào)。其狀態(tài)轉(zhuǎn)換關(guān)系如圖5所示。s代表同步容差，當(dāng)相關(guān)檢測(cè)值d≤s時(shí)，便看作檢測(cè)到幀同步碼組。這樣即使由于干擾造成s位的誤碼，也可以檢測(cè)到幀同步碼組。其余兩個(gè)參數(shù)α(前向校驗(yàn)門限)和β(后向校驗(yàn)門限)，為幀同步狀態(tài)起到保護(hù)作用。

狀態(tài)機(jī)的初始狀態(tài)為搜索態(tài)，同步之前，判決模塊會(huì)在每個(gè)時(shí)鐘比較d與s的值，當(dāng)檢測(cè)到d小于s時(shí)，便可以判定為檢測(cè)到幀同步碼，并立即啟動(dòng)狀態(tài)機(jī)轉(zhuǎn)到入鎖校驗(yàn)態(tài)。

在入鎖校驗(yàn)態(tài)，為了避免受信號(hào)中假同步碼的影響，當(dāng)檢測(cè)到幀同步字后，會(huì)每隔一幀長(zhǎng)度對(duì)檢測(cè)值進(jìn)行判決。當(dāng)連續(xù)α次判決正確時(shí)，則判定為找到幀同步信號(hào)，并控制狀態(tài)機(jī)進(jìn)入鎖定態(tài)，否則，判定為假同步，并回到搜索態(tài)接著進(jìn)行搜索。

圖5　狀態(tài)轉(zhuǎn)換關(guān)系圖

進(jìn)入鎖定態(tài)后，狀態(tài)機(jī)開始輸出幀同步信號(hào)到輸出控制模塊，同時(shí)判決模塊每隔一幀對(duì)檢測(cè)值進(jìn)行判決，當(dāng)丟失幀同步信息時(shí)，便進(jìn)入失鎖校驗(yàn)態(tài)。這時(shí)，如果連續(xù)β次丟失幀同步信號(hào)，則判定已經(jīng)失步，控制狀態(tài)機(jī)進(jìn)入搜索態(tài)，重新開始搜索;如果期間又檢測(cè)到幀同步碼組，則回到鎖定態(tài)。

雙重校驗(yàn)的判決可在捕獲或失步發(fā)生時(shí)相應(yīng)的增加其置信度，當(dāng)達(dá)到一定值時(shí)才認(rèn)定捕獲或失步事件發(fā)生，這樣幀同步器具有較強(qiáng)的保護(hù)能力。在實(shí)際使用時(shí)，可以針對(duì)不同的幀結(jié)構(gòu)和信道傳輸特性，采用合適的容差值和保護(hù)參數(shù)，最大限度的提升幀同步器的性能。

圖6　接口電路原理圖

3　輸入接口電路

解碼電路具有單端接口和差分接口，兩個(gè)接口通過數(shù)字隔離器進(jìn)行隔離及電平轉(zhuǎn)換。單端接口輸入的PCM數(shù)據(jù)流通過數(shù)字隔離器ADuM1201送入FPGA;差分?jǐn)?shù)據(jù)流輸入到差分芯片DS26C32，再通過隔離器送入FPGA。接口電路如圖6所示。DS26C32的上升下降時(shí)間為4 ns，最大不超過9 ns，而PCM碼輸入信號(hào)速率最大為10 Mbit/s，脈寬為100 ns，可見DS26C32完全滿足設(shè)計(jì)要求。

數(shù)字隔離器選用AD公司的ADuM1201芯片，該芯片采用iCoupler磁隔離技術(shù)，在性能、功耗、體積等各方面都比傳統(tǒng)光電隔離器件(光耦)有巨大優(yōu)勢(shì)。ADuM1201隔離器在一個(gè)器件中提供兩個(gè)獨(dú)立的隔離通道。兩端工作電壓為2.7 V～5.5 V，支持低電壓工作并能實(shí)現(xiàn)電平轉(zhuǎn)換。傳輸速率可達(dá)25 Mbit/s，瞬態(tài)共模抑制25 kV/μs，最大脈寬失真＜3 ns，它的轉(zhuǎn)換原理是輸入端與輸出端使用不同電壓供電，將它們作為參考電壓實(shí)現(xiàn)電平轉(zhuǎn)換。在本設(shè)計(jì)中芯片輸入供電電壓為5 V，輸出供電電壓為3.3 V時(shí)，信號(hào)可以實(shí)現(xiàn)由5 V到3.3 V的電平轉(zhuǎn)換。

4　實(shí)測(cè)結(jié)果

實(shí)測(cè)時(shí)利用一個(gè)PCM信號(hào)源輸出一組固定幀結(jié)構(gòu)的PCM數(shù)據(jù)流，使用單端接口接入本解碼電路，最后通過上位機(jī)軟件進(jìn)行顯示分析。圖7為截取的部分?jǐn)?shù)據(jù)，其中副幀的同步碼組為EB 90H，幀結(jié)束標(biāo)志碼組為14 6FH，每一列的數(shù)據(jù)為一路，各路分別為正弦波，方波，三角波，鋸齒波依次循環(huán)3組，加上碼組共14列，圖8中的數(shù)據(jù)幀同步碼組為9A BC B5 2CH，幀結(jié)束標(biāo)志碼組為65 43 4A D3H，同樣也是4種波形數(shù)據(jù)重復(fù)3組，共16列。為了驗(yàn)證不同碼率的接收效果，用上位機(jī)繪圖軟件來根據(jù)不同碼率進(jìn)行波形圖繪制，1 Mbit/s時(shí)繪圖窗口每屏可顯示50個(gè)采樣點(diǎn)，2 Mbit/s可顯示100個(gè)，依次類推，10 Mbit/s時(shí)每屏可顯示500個(gè)采樣點(diǎn)，這里截取了碼率為1 Mbit/s (圖9)和10 Mbit/s(圖10)時(shí)繪出的正弦波。

圖7　幀同步碼組為EB 90H

圖8　幀同步碼組為9A BC B5 2CH

圖9　碼率1 Mbit/s 波形圖

圖10　碼率10 Mbit/s波形圖

5　結(jié)論

本文所設(shè)計(jì)電路使用FPGA實(shí)現(xiàn)PCM解碼系統(tǒng)的關(guān)鍵部分，并具有通用單端及差分接，能接收不同幀結(jié)構(gòu)，不同碼速率的PCM數(shù)據(jù)流。經(jīng)過實(shí)際測(cè)試，電路工作穩(wěn)定，抗誤碼能力強(qiáng)，可根據(jù)實(shí)際情況靈活配置參數(shù)，根據(jù)以上特點(diǎn)，該設(shè)計(jì)對(duì)于遙測(cè)領(lǐng)域的測(cè)試儀器和其他領(lǐng)域的通信設(shè)備都具有很大的參考價(jià)值。

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謝秀峰(1989－)，男，漢族，山西原平人，碩士研究生，主要研究方向?yàn)閯?dòng)態(tài)測(cè)試與智能儀器，xxfzb2008@ sina.com;

蘇淑靖(1971－)，女，漢族，山西呂梁人，副教授，碩士生導(dǎo)師，主要研究方向?yàn)楦兄c探測(cè)，信號(hào)處理sushujing @ nuc.edu.cn。

項(xiàng)目來源:河南省省院科技合作項(xiàng)目(131PYSGZ211);鄭州市院士工作站建設(shè)計(jì)劃項(xiàng)目(122106000049)

Design of Picosecond Short Pulse Based on Dual NOT Gates Structure*

ZHAO Hongmei*，WANG Yuanpu，CUI Guangzhao
(Institute of Electric and Information Engineering，Zhengzhou University of Light Industry，Zhengzhou 450002，China)

Abstract:Narrow pulse generation is a key technology in Ultra-wideband communication systems，and different applications have different requirements for pulse generation.This paper analyzes several conventional Ultra-wideband narrow pulse generation methods in Ultra-wideband indoor positioning system.Their advantages，disadvantages and the existing problems are discussed.On this basis，a pulse generator is designed based on digital method firstly.Then propose a novel Ultra-wideband narrow pulse generation method which based on dual NOR gates structure by analyzing the simulation results of the designed pulse generator.The simulation results show that pulse repetition frequency obtained by using the method is 10 MHz，and the duration time is 150 ps.The experimental circuit test results are basically consistent with the theoretical analysis and simulation results.Compared with the conventional narrow pulse generation method of digital circuit，this method is simple，low cost and the requirement is not high to the devices.Moreover，the obtained pulse width is narrower than dozen times and higher positioning accuracy.

Key words:Ultra-wideband; picosecond level short pulse; digital circuit; the race and competition phenomenon; dual NOT gate

中圖分類號(hào):TN707

文獻(xiàn)標(biāo)識(shí)碼:A

文章編號(hào):1005－9490(2015) 03－0543－05

收稿日期:2014－06－06修改日期:2014－07－10

doi:EEACC:1230J10.3969/j.issn.1005－9490.2015.03.015