基于ｔｏｐ—ｄｏｗｎ方法的數(shù)字頻率計(jì)的設(shè)計(jì)與實(shí)現(xiàn)
2004-07-26 23:54:30杜玉遠(yuǎn)
電子世界 2004年5期
杜玉遠(yuǎn)
摘要本丈介紹了在開(kāi)發(fā)設(shè)計(jì)復(fù)雜可編程器件FPGA和CPLD過(guò)程中，經(jīng)常采用的自上而下(top-down)設(shè)計(jì)方法，并詳細(xì)地介紹了采用這種設(shè)計(jì)方法完成數(shù)字頻率計(jì)的設(shè)計(jì)過(guò)程，同時(shí)還闡述了這種設(shè)計(jì)方法中的層次的劃分過(guò)程。
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