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        基于FPGA和MSP430的脈沖參數(shù)測(cè)試儀設(shè)計(jì)

        2018-09-04 06:25:00
        關(guān)鍵詞:脈沖單片機(jī)頻率

        范 燕 唐 龍

        (常州信息職業(yè)技術(shù)學(xué)院電子與電氣工程學(xué)院 江蘇常州 213164)

        0 引言

        脈沖參數(shù)測(cè)試儀是以時(shí)域瞬態(tài)信號(hào)為測(cè)量對(duì)象的脈沖參數(shù)測(cè)量技術(shù)[1]。目前,在數(shù)字通信、雷達(dá)、核物理、計(jì)算機(jī)、地質(zhì)勘探、力學(xué)、激光、遙感、生物、廣播電視、醫(yī)療電子等眾多領(lǐng)域,脈沖測(cè)量技術(shù)應(yīng)用十分廣泛[2]。經(jīng)過最近30年的發(fā)展,脈沖參數(shù)計(jì)量測(cè)試技術(shù)已成為無線電電子學(xué)計(jì)量專業(yè)重要的組成部分。隨著脈沖參數(shù)計(jì)量測(cè)試技術(shù)的進(jìn)一步發(fā)展和相關(guān)計(jì)量參數(shù)研究?jī)?nèi)容的相互滲透,其研究方法更加完善、研究手段更加先進(jìn),技術(shù)基礎(chǔ)作用也更加明顯[3]。

        1 設(shè)計(jì)目標(biāo)及原理

        本系統(tǒng)預(yù)期目標(biāo)是設(shè)計(jì)并制作一個(gè)數(shù)字顯示的周期性矩形脈沖信號(hào)參數(shù)測(cè)量?jī)x,輸入阻抗為50 Ω。同時(shí)設(shè)計(jì)并制作一個(gè)標(biāo)準(zhǔn)矩形脈沖信號(hào)發(fā)生器,作為測(cè)試儀的附加功能。具體要求:①測(cè)量脈沖信號(hào)頻率,頻率范圍為10 Hz~2 MHz,測(cè)量誤差的絕對(duì)值不大于0.1%;②測(cè)量脈沖信號(hào)占空比D,測(cè)量范圍為10%~90%,測(cè)量誤差的絕對(duì)值不大于2%;③測(cè)量脈沖信號(hào)幅度,幅度范圍為0.1~10 V,測(cè)量誤差的絕對(duì)值不大于2%;④測(cè)量脈沖信號(hào)上升時(shí)間,測(cè)量范圍為50.0~999 ns,測(cè)量誤差的絕對(duì)值不大于5%;⑤提供一個(gè)標(biāo)準(zhǔn)矩形脈沖信號(hào)發(fā)生器,要求:a)頻率為1 MHz,誤差的絕對(duì)值不大于0.1%;b)脈寬為100 ns,誤差的絕對(duì)值不大于1%;c)幅度為5±0.1 V(負(fù)載電阻為50);d)上升時(shí)間不大于30 ns,過沖不大于5%。

        本系統(tǒng)的設(shè)計(jì)原理是將輸入的脈沖信號(hào)經(jīng)THS300電路緩沖衰減處理后,將信號(hào)幅度控制在3.3~5 V范圍,接著利用FPGA控制系統(tǒng)對(duì)處理過的信號(hào)進(jìn)行等精度測(cè)頻及脈寬測(cè)量,輸出數(shù)字量傳送給MSP430控制系統(tǒng)進(jìn)行處理,并將結(jié)果在LCD12864上顯示出來。系統(tǒng)的結(jié)構(gòu)框圖如圖1所示。

        圖1 系統(tǒng)結(jié)構(gòu)框圖

        2 技術(shù)方案分析比較

        2.1 測(cè)量頻率的論證與選擇

        方案一:IAP15F61S單片機(jī)。本方案使用IAP15F61S的外部中斷和定時(shí)器“0”共同控制下,外部中斷采用上升沿檢測(cè)計(jì)數(shù),定時(shí)器控制1秒的時(shí)間閘門信號(hào),1秒內(nèi)外部中斷累計(jì)的脈沖次數(shù)就是信號(hào)的頻率。方案簡(jiǎn)單易行,成本較低,但是只能測(cè)低頻[4]。

        方案二:純硬件電路。本方案采用74HC04進(jìn)行放大整形發(fā)送數(shù)碼管,穩(wěn)定性好,但是設(shè)計(jì)復(fù)雜,成本較高。

        方案三:FPGA和單片機(jī)結(jié)合。本方案利用FPGA的高速性和可靠性,對(duì)處理過的信號(hào)進(jìn)行等精度測(cè)頻及脈寬測(cè)量,再利用單片機(jī)的運(yùn)算能力,對(duì)信號(hào)進(jìn)行數(shù)字處理,并將結(jié)果在LCD上顯示出來。本方案FPGA、單片機(jī)易編寫,使用方便,滿足本題需要。

        方案選擇:綜合以上三種方案,選擇方案三。

        2.2 前級(jí)電路的論證與選擇

        方案一:用繼電器進(jìn)行調(diào)擋,利用反饋電阻的阻值不一樣,進(jìn)行放大和衰減,高速AD進(jìn)行采集。

        方案二:壓控放大電路和峰值檢波。波峰檢波電路可以將正弦波和方波取其峰值,進(jìn)行電阻分壓,進(jìn)行采樣后數(shù)值送到液晶顯示。

        方案選擇:綜合以上方案,選擇方案二。

        2.3 控制系統(tǒng)的論證與選擇

        方案一:15系列單片機(jī)。價(jià)格便宜,性能比51單片機(jī)高出很多。但是在高速電路中可能速度不夠,片內(nèi)集成資源少。

        方案二:MSP430單片機(jī)。低電源電壓范圍,1.8~3.6 V。超低功耗,擁有5種低功耗模式,靈活的時(shí)鐘使用模式。高速的運(yùn)算能力,16位RISC架構(gòu),125 ns指令周期。豐富的功能模塊,多通道10-14位AD轉(zhuǎn)換器;雙路12位DA轉(zhuǎn)換器;綜合考慮采用MSP430單片機(jī)[5]。

        方案選擇:綜合以上方案,選擇方案二。

        3 功能指標(biāo)實(shí)現(xiàn)方法

        FPGA片內(nèi)包括等精度測(cè)頻模塊、占空比測(cè)量模塊、時(shí)間檢測(cè)模塊、分頻脈沖信號(hào)發(fā)生器模塊及數(shù)據(jù)傳輸模塊。

        3.1 脈沖信號(hào)頻率的測(cè)量

        測(cè)量脈沖信號(hào)頻率(如圖2)主要是利用FPGA等精度測(cè)量法,以FPGA開發(fā)板上的50 MHz晶振作為基準(zhǔn)頻(Fs),F(xiàn)PGA對(duì)基準(zhǔn)頻計(jì)數(shù)為Ns,對(duì)被測(cè)頻率Fx計(jì)數(shù)計(jì)為Nx,通過公式:Fx = Fs*Nx/Nx,實(shí)現(xiàn)等精度計(jì)算測(cè)量頻率。

        圖2 等精度測(cè)頻模塊

        3.2 脈沖信號(hào)占空比的測(cè)量

        脈沖信號(hào)占空比(如圖3)主要以FPGA開發(fā)板自帶50 MHz作為基準(zhǔn),通過基準(zhǔn)計(jì)數(shù)實(shí)現(xiàn)對(duì)脈沖信號(hào)正負(fù)脈寬的測(cè)量,從而實(shí)現(xiàn)對(duì)脈沖占空比的測(cè)量。設(shè)正脈寬為Pn,負(fù)脈寬為Pp,則周期T=Pn+Pp,占空比Du=Pn/T=Pn/(Pn+Pp)。

        圖3 占空比測(cè)量模塊

        3.3 脈沖信號(hào)幅度的測(cè)量

        脈沖幅度測(cè)量(如圖4)主要是利用峰值檢波電路,將輸入的脈沖信號(hào)整形為等幅的直流信號(hào),然后將直流信號(hào)輸入MSP430單片機(jī),MSP430利用自帶的ADC12將電壓信號(hào)采集轉(zhuǎn)換成數(shù)字信號(hào),通過數(shù)據(jù)處理得到數(shù)字信號(hào)的幅度值。

        圖4 時(shí)間檢測(cè)模塊

        3.4 1 MHz矩形脈沖信號(hào)發(fā)生器的實(shí)現(xiàn)

        矩形脈沖信號(hào)發(fā)生器(如圖5)主要利用FPGA開發(fā)板自帶的50 MHz晶振50分頻,并通過控制系統(tǒng)內(nèi)部計(jì)時(shí)控制脈寬為10%[6]。

        4 系統(tǒng)軟件設(shè)計(jì)分析

        測(cè)量各參數(shù)軟件流程圖如圖6所示。

        圖5 分頻脈沖信號(hào)發(fā)生器模塊

        圖6 軟件流程圖

        5 作品成效總結(jié)分析

        1)測(cè)頻信號(hào)測(cè)試結(jié)果(單位HZ/V)如表1:

        表1 頻率測(cè)試結(jié)果

        2)占空比測(cè)試結(jié)果(單位/V)如表2:

        表2 占空比測(cè)試結(jié)果

        3)幅度信號(hào)測(cè)試結(jié)果如表3所示:(單位/V)

        表3 脈沖幅度變化的數(shù)據(jù)

        所測(cè)得的數(shù)據(jù)均在誤差范圍之內(nèi),達(dá)到了所有的性能指標(biāo)。

        6 結(jié)論

        本次作品在制作過程中遇到了許多問題,由于題目參數(shù)的要求,測(cè)量頻率的范圍最高要達(dá)到2 MHz,測(cè)量誤差絕對(duì)值不大于0.1%,普通的51單片機(jī)無法實(shí)現(xiàn)對(duì)2 MHz頻率的測(cè)量。為了頻率測(cè)量的準(zhǔn)確性和穩(wěn)定性,采用FPGA對(duì)頻率和占空比的精確測(cè)量,并將測(cè)量到的數(shù)據(jù)傳送給MSP430單片機(jī)進(jìn)行顯示。由于涉及MSP430單片機(jī)和FPGA的編程聯(lián)調(diào),在測(cè)試的過程中,出現(xiàn)MSP430無法采集到FPGA傳送的數(shù)據(jù),這時(shí)就需要一級(jí)一級(jí)進(jìn)行測(cè)試,需要對(duì)FPGA是否采集到頻率信號(hào)進(jìn)行檢測(cè),同時(shí)也需要排查接線是否插好,還要檢查單片機(jī)的數(shù)據(jù)接收程序和數(shù)據(jù)處理是否有問題,這對(duì)處理問題能力的提升有很大幫助。

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