楊志芳，胡夢蝶，陳玨，王磊

武漢工程大學(xué)電氣信息學(xué)院，湖北武漢430205

基于SoCFPGA同步數(shù)據(jù)采集系統(tǒng)的設(shè)計

楊志芳，胡夢蝶，陳玨，王磊

武漢工程大學(xué)電氣信息學(xué)院，湖北武漢430205

為實現(xiàn)電能質(zhì)量分析系統(tǒng)多通道數(shù)據(jù)同步采集的功能，設(shè)計一種基于SoCFPGA的同步數(shù)據(jù)采集系統(tǒng)，采用Altera SoCFPGA為核心硬件平臺，結(jié)合ADS8364模數(shù)轉(zhuǎn)換芯片構(gòu)建了6通道數(shù)據(jù)同步采集系統(tǒng).首先，采用軟硬件協(xié)同設(shè)計方法，使用VHDL對AD轉(zhuǎn)換控制過程的邏輯進行描述，然后利用FFT核進行數(shù)據(jù)處理，對測試數(shù)據(jù)的幅頻特性進行顯示，為后續(xù)的諧波分析做準(zhǔn)備.仿真結(jié)果表明：SoCFPGA實現(xiàn)了對ADS8364的控制以及512點FFT運算.系統(tǒng)使得數(shù)據(jù)采集硬件結(jié)構(gòu)更加簡單，集成化程度更高，縮短了系統(tǒng)開發(fā)周期，能夠滿足數(shù)據(jù)同步采集的實際需求.

同步數(shù)據(jù)采集；SoCFPGA；ADS8364；軟件仿真

1 引言

電能是當(dāng)代社會最為依賴的能源，電能的應(yīng)用深入到生活中的方方面面，由于電力電子技術(shù)的飛速發(fā)展，在現(xiàn)代社會中，一些大功率變流、變頻裝置等在電力系統(tǒng)中被廣泛地應(yīng)用，變頻、變流這些裝置對電網(wǎng)造成非常嚴(yán)重的諧波污染，導(dǎo)致電能質(zhì)量下降，進而會影響到一些高精度自動化儀表的工作特性.因此，開展對電能質(zhì)量的監(jiān)測十分重要，同時電能質(zhì)量問題也是影響電力系統(tǒng)運行和國民經(jīng)濟發(fā)展的關(guān)鍵因素.多通道數(shù)據(jù)采集作為一種計算機從外部實時獲取并處理信息的方法，其重要性不言而喻［1］.現(xiàn)有的數(shù)據(jù)采集方案往往以DSP或單片機作為控制器，用來控制存儲器、ADC（模/數(shù)轉(zhuǎn)換器）和其他的外圍電路的工作.但是由于單片機受到自身的指令周期以及處理速度的限制，還未能達(dá)到多通道高速數(shù)據(jù)采集系統(tǒng)的要求，DSP相對于單片機，能夠?qū)崿F(xiàn)更高速的數(shù)據(jù)采集，但是在速度提高的同時，會使得系統(tǒng)的成本相應(yīng)提高.DSP和單片機的各種功能要依靠軟件的運行來實現(xiàn)，且執(zhí)行的效率和速度往往不高，軟件的運行時間占用了很大一部分的采樣時間［2］.在現(xiàn)有的研究基礎(chǔ)上，設(shè)計了一種基于SoCFPGA的同步數(shù)據(jù)采集系統(tǒng)，F(xiàn)PGA在高速數(shù)據(jù)采集方面比單片機和DSP要更有優(yōu)勢，其執(zhí)行速度快，內(nèi)部的延時小，控制邏輯均由硬件編程語言來實現(xiàn)，片內(nèi)時鐘的頻率高，開發(fā)效率高.通過仿真驗證了數(shù)據(jù)采集系統(tǒng)的可行性，可以應(yīng)用于高速實時數(shù)據(jù)采集等領(lǐng)域.

2 系統(tǒng)原理

為了滿足質(zhì)量檢測的需要，對電能質(zhì)量的關(guān)鍵指標(biāo)加以研究，以Altera公司的SoCFPGA芯片為開發(fā)平臺，進行硬件和軟件的設(shè)計，實現(xiàn)電能質(zhì)量分析儀的研制.系統(tǒng)中電壓、電流互感器用來采集電網(wǎng)三相電壓和三相電流數(shù)據(jù)，經(jīng)過調(diào)理電路后輸送到AD芯片進行模數(shù)轉(zhuǎn)換.SoCFPGA的FPGA子系統(tǒng)主要用來控制AD芯片進行模數(shù)轉(zhuǎn)換并對AD轉(zhuǎn)換結(jié)果進行FFT運算，將AD轉(zhuǎn)換結(jié)果和FFT分析結(jié)果送入SoCFPGA的ARM子系統(tǒng)，電能質(zhì)量的相關(guān)參數(shù)：三相電壓電流有效值，功率因數(shù)，三相電壓電流不平衡度等的計算及電壓瞬變、閃變、諧波分析均在SoCFPGA的ARM子系統(tǒng)中完成［3-4］.系統(tǒng)可以對測量數(shù)據(jù)與分析結(jié)果進行本地存儲.系統(tǒng)的測量結(jié)果利用MTL2觸摸屏可進行本地顯示及回放.通過配備的以太網(wǎng)接口，與遠(yuǎn)程服務(wù)器進行通訊，可以實現(xiàn)數(shù)據(jù)的上傳與遠(yuǎn)端保存.本文主要研究的是對獲取的三相電壓電流進行AD轉(zhuǎn)換以及FFT部分，整體的系統(tǒng)原理框圖如圖1所示.

圖1 系統(tǒng)原理框圖Fig.1System principle block diagram

3 數(shù)據(jù)采集系統(tǒng)硬件介紹

3.1 SoCFPGA介紹

在數(shù)據(jù)采集部分中將被測量的電壓、電流數(shù)據(jù)先分別通過電壓、電流互感器進行采集，然后經(jīng)過信號調(diào)理電路如差分信號放大等將數(shù)據(jù)送到AD芯片中進行模/數(shù)轉(zhuǎn)換.對于數(shù)據(jù)采集部分，必須配以一個高速、高精度的CPU（本文中為SoCFPGA的FPGA子模塊），使其具備實時事務(wù)處理能力和數(shù)據(jù)處理能力［5］，本系統(tǒng)中用到的SoCFPGA器件在同一個器件中同時集成了處理器和FPGA體系結(jié)構(gòu)，將兩種技術(shù)合并起來，系統(tǒng)具有更高的集成度，更低的功耗，節(jié)省了電路板面積，其中的雙核ARM Cortex-A9處理器子系統(tǒng)與FPGA子系統(tǒng)之間通信的帶寬大大增加.FPGA子系統(tǒng)能夠高速完成數(shù)字信號處理算法及FFT運算、電壓閃變計算等任務(wù)，對于6路的LVDS信號采集、調(diào)理、濾波、整合可以用FPGA子系統(tǒng)進行并行處理，大大加速了系統(tǒng)的進程［6］.通過大吞吐量數(shù)據(jù)通路（AXI），實現(xiàn)ARM Cortex-A9 MPCore處理器系統(tǒng)和FPGA的互聯(lián)，峰值帶寬超過100 Gbps，保證了數(shù)據(jù)傳輸?shù)倪B續(xù)性，與其他應(yīng)用處理器相比，功耗大大降低，提高了系統(tǒng)的性能［7］.

3.2 ADS8364芯片簡介

本系統(tǒng)選用的A/D轉(zhuǎn)換芯片型號為TI公司的ADS8364芯片.ADS8364是TI公司生產(chǎn)的一款6通道同步采樣的模數(shù)轉(zhuǎn)換器，具有高速、低功耗的特點，采用的是+5 V供電，而且?guī)в?0 dB共模抑制的全差分輸入通道、6個獨立的模數(shù)轉(zhuǎn)換器，符合本文多路數(shù)據(jù)采集系統(tǒng)的需要.ADS8364對數(shù)據(jù)進行轉(zhuǎn)換的結(jié)果是16位，由BYTE、ADD和地址線A2、A1、A0的組合控制來分別設(shè)置為直接讀取方式、循環(huán)讀取方式以及FIFO方式［8］.模擬與數(shù)字邏輯電源均采用+5 V供電，數(shù)字接口緩沖電源采用3 V～5 V，使其能夠方便地與FPGA進行接口設(shè)計. ADS8364工作時序圖如圖2所示.

圖2 ADS8364工作時序圖Fig.2Operational timing chart of ADS8364

3.3 數(shù)據(jù)采集系統(tǒng)設(shè)計原理

將ADS8364與SoCFPGA的FPGA子系統(tǒng)相連，AD轉(zhuǎn)換的控制信號由FPGA子系統(tǒng)給出，同時，ADS8364工作所需的時鐘信號也由FPGA給出，這樣可以靈活地改變時鐘速率，以便在不同的速率下進行調(diào)整，便于FPGA做整體的時序控制.在模/數(shù)轉(zhuǎn)換過程中，F(xiàn)PGA子系統(tǒng)通過對啟動轉(zhuǎn)換控制引腳，時鐘引腳等的控制來進行AD轉(zhuǎn)換.當(dāng)ADS8364的HOLDX保持至少20 ns的低電平時，開始進行AD轉(zhuǎn)換.當(dāng)轉(zhuǎn)換結(jié)束后，轉(zhuǎn)換結(jié)果將被存入輸出寄存器，在ADS8364芯片的------EOC引腳會產(chǎn)生一個低電平信號，此低電平信號會觸發(fā)FPGA選通AD芯片的片選信號，同時訪問AD模塊預(yù)先設(shè)定的地址空間，并讀取AD轉(zhuǎn)換后寄存器里的數(shù)據(jù)［9-12］.將RD和CS引腳設(shè)置為低電平可以讓數(shù)據(jù)通過并行輸出總線讀出.在讀取數(shù)據(jù)后，F(xiàn)PGA在下一次數(shù)據(jù)采集過程之前，完成對數(shù)據(jù)的處理.數(shù)據(jù)采集模塊的硬件結(jié)構(gòu)圖如圖3所示.

圖3 數(shù)據(jù)采集模塊硬件結(jié)構(gòu)圖Fig.3Hardware structure diagram of data acquisition module

4 數(shù)據(jù)采集系統(tǒng)軟件設(shè)計及仿真

4.1 系統(tǒng)軟件設(shè)計

在Altera公司的Quartus II13.0軟件平臺下，使用VHDL硬件描述語言進行邏輯描述，根據(jù)ADS8364的工作原理及工作時序分析，把整個工作流程分為START、READ0、CONVERT、READ1、 READ2、READ3六個工作狀態(tài)，各個狀態(tài)之間的轉(zhuǎn)換關(guān)系及在EDA工具中進行編譯與仿真的ADS8364控制時序圖分別如圖4、圖5所示.對比圖5和圖2可以看出FPGA子系統(tǒng)實現(xiàn)了對ADS8364的正確控制，仿真結(jié)果基本與ADS8364的工作時序相符.

圖4 狀態(tài)轉(zhuǎn)移圖Fig.4State transition diagram

圖5 系統(tǒng)仿真圖Fig.5System simulation diagram

4.2 諧波分析

諧波分析的核心是FFT（快速傅里葉變換），將AD轉(zhuǎn)換產(chǎn)生的數(shù)字信號由時域變換到頻域，為后期的諧波分析做準(zhǔn)備，對檢測到的一個周期的諧波信號進行傅里葉變換，得到各次諧波的相位和幅值.采用FFT對量化后的被測信號進行處理，獲得基波和各次諧波的電壓，從而計算出失真度，失真度的計算公式為

式（1）中：γ為失真度；P為信號的總功率；P1為基波信號的功率；U1為基波電壓的有效值；U2～Un為諧波電壓的有效值.

FFT運算器采用FFT MegaCore實現(xiàn).本系統(tǒng)用到Altera公司Cyclone V系列5CSEMA5，該芯片能夠完全支持FFT MegaCore，能有效提高FFT部分的開發(fā)效率，縮短工程開發(fā)周期［13-15］.為了盡量減少轉(zhuǎn)換時間，將FFT處理器設(shè)置成四輸出引擎結(jié)構(gòu)，算法用到了基-4FFT算法，I/O數(shù)據(jù)流結(jié)構(gòu)設(shè)置為Buffered Burst，采樣點數(shù)設(shè)置為512點，能夠占用更小的內(nèi)存資源.設(shè)計中只需對FFT IP核進行配置以及數(shù)據(jù)輸入和結(jié)果讀取.

4.3 FFT仿真

在MATLAB中產(chǎn)生用于測試的輸入數(shù)據(jù)，將其寫入到.mif文件中，對數(shù)據(jù)的實部和虛部信息進行保存，用作測試數(shù)據(jù)，輸入數(shù)據(jù)信息如圖6所示.在Quartus II 13.0軟件中對FFT IP核進行配置，并且添加兩個ROM分別存儲輸入數(shù)據(jù)的實部和虛部.FPGA用來對輸入數(shù)據(jù)做FFT運算.FFT部分在Modelsim中的仿真結(jié)果如圖7所示，F(xiàn)PGA對輸入數(shù)據(jù)的實部虛部信息進行了存儲.MATLAB對FFT運算后的數(shù)據(jù)分析如圖8所示.

圖6 測試數(shù)據(jù)信息（a）幅頻特性；（b）測試數(shù)據(jù)實部；（c）測試數(shù)據(jù)虛部Fig.6Information of test data（a）Amplitude-frequency characteristics；（b）Real part of test data；（c）Imaginary part of test data

圖7 FFT仿真Fig.7FFT simulation

圖8 MATLAB仿真Fig.8MATLAB simulation

通過對比圖6和圖8，可以看出：FPGA實現(xiàn)了512點的FFT運算.

5 結(jié)語

筆者設(shè)計的SoCFPGA的同步數(shù)據(jù)采集系統(tǒng)，實現(xiàn)了SoCFPGA對ADS8364的控制，同時也實現(xiàn)了512點的FFT運算.選用SoCFPGA作為控制器件，充分發(fā)揮ADS8364芯片的高速、高精度的特點，使得集成化程度大大提高，數(shù)據(jù)采集硬件更加簡單，控制更加靈活，另外，F(xiàn)PGA編程方式靈活，軟件工具強大，可縮短系統(tǒng)的開發(fā)周期，提高工作效率.因此，本系統(tǒng)可用于高速實時數(shù)據(jù)采集系統(tǒng)等領(lǐng)域.

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本文編輯：陳小平

Design of Synchronous Data Acquisition System Based on SoCFPGA

YANG Zhifang，HU Mengdie，CHEN Jue，WANG Lei
School of Electrical and Information Engineering，Wuhan Institute of Technology，Wuhan 430205，China

To meet the requirements of multi-channel data acquisition in power quality analysis system，we designed a synchronous data acquisition system based on SoCFPGA，taking Altera SoCFPGA as the core of the hardware platform and combining with the analog-digital conversion chip ADS8364 to build the 6 channels synchronous data acquisition system.Firstly，we employed both software and hardware for co-design，and described the logic of the AD conversion control process in VHDL，and then the data were processed by FFT core and the amplitude-frequency characteristics of them were displayed，which prepared for the following harmonic analysis.The simulation results indicate that SoCFPGA is able to well control the ADS8364 and 512-point FFT operation.The system makes the data acquisition hardware structure simpler and the degree of integration higher，which shortens the system development cycle，meeting the needs of data synchronous acquisition in practice.

synchronous data acquisition；SoCFPGA；ADS8364；software simulation

TP211

A

10.3969/j.issn.1674-2869.2016.06.014

1674-2869（2016）06-0588-06

2016-06-15

湖北省科技廳自然科學(xué)基金項目（2014CKC524）

楊志芳，碩士，副教授.E-mail：frank@wit.edu.cn