(中國電子科技集團(tuán)公司第三十八研究所,安徽合肥230088)

0 引言

軟件無線電(SDR)是無線通信技術(shù)發(fā)展的重要方向。軟件無線電的關(guān)鍵思想之一是將數(shù)據(jù)采集系統(tǒng)盡可能地向射頻前端靠攏,因此直接射頻采樣技術(shù)逐漸成為數(shù)字接收機(jī)的重要發(fā)展趨勢[1-2]。近年來,隨著超寬帶技術(shù)的發(fā)展,高速和寬帶采樣已經(jīng)成為軟件無線電的基本要求,但由于目前ADC器件的水平限制,采樣率和帶寬遠(yuǎn)遠(yuǎn)達(dá)不到實(shí)際應(yīng)用的需求,因此直接射頻采樣技術(shù)在高速超寬帶數(shù)據(jù)采集系統(tǒng)中的應(yīng)用受到了很大的限制。

采樣保持器(SHA)是ADC芯片的重要組成部分,采樣保持器的性能直接影響著ADC芯片的轉(zhuǎn)換速度和精度。本系統(tǒng)采用外置高性能采樣保持器1821TH+ADC芯片的架構(gòu)進(jìn)行設(shè)計(jì),彌補(bǔ)了原有ADC芯片模擬輸入帶寬不足的缺點(diǎn),實(shí)現(xiàn)了超寬帶信號的直接射頻采樣。

1 采樣保持器

采樣保持器的簡易工作原理如圖1所示[3]。采樣保持器的作用是跟蹤和保持模擬輸入信號的電平值。其工作狀態(tài)有采樣狀態(tài)和保持狀態(tài)兩種。采樣狀態(tài)和保持狀態(tài)的工作周期等于采樣時(shí)鐘周期。采樣開關(guān)導(dǎo)通時(shí),為采樣狀態(tài),此時(shí)采樣保持器對模擬輸入信號進(jìn)行跟蹤;采樣開關(guān)斷開時(shí),為保持狀態(tài),采樣保持器保持為斷開瞬間的輸入信號電平值。采樣保持器的最大采樣時(shí)鐘由采樣保持器的孔徑抖動(dòng)、帶寬等因素決定[4]。

圖1 采樣保持器的工作原理

本系統(tǒng)中采用的采樣保持器為Inphi公司生產(chǎn)的1821TH,最大采樣率為2 GS/s。該芯片采用主從設(shè)計(jì),包含兩級采樣保持電路。輸入端可以是單端信號或差分信號,輸出差分信號。主從兩級采樣保持器可以共用一路時(shí)鐘,也可各自供應(yīng)時(shí)鐘。該采樣保持器的模擬輸入帶寬對小信號可達(dá)18 GHz,對0.5 Vpp的信號可達(dá)15 GHz,對1 Vpp的信號可達(dá)12 GHz[5]。極寬的輸入信號帶寬,可以省去模擬下變頻電路,降低設(shè)計(jì)復(fù)雜度,提高系統(tǒng)性能。

2 系統(tǒng)組成及工作原理

基于采樣保持器的直接射頻采樣數(shù)字接收機(jī)是基于FMC架構(gòu)進(jìn)行設(shè)計(jì)的,其結(jié)構(gòu)框圖如圖2所示[6]。FMC標(biāo)準(zhǔn)為ANSI標(biāo)準(zhǔn),由FPGA廠家及其用戶聯(lián)合制訂[7]。該接收機(jī)按照子母板架構(gòu)進(jìn)行設(shè)計(jì),母板和子板之間通過FMC連接器相連。FMC母板為通用型電路板,FMC子板為功能性AD子板,另外預(yù)留一個(gè)時(shí)鐘子板。在系統(tǒng)需求變化時(shí),只需重新設(shè)計(jì)AD子板,降低了設(shè)計(jì)復(fù)雜度,節(jié)省了成本。

圖2 基于FMC的數(shù)據(jù)采集系統(tǒng)框圖

FMC母板包括一片Virtex-7和相應(yīng)的配置電路、時(shí)鐘管理模塊、光模塊、電源模塊以及接口模塊。在硬件上實(shí)現(xiàn)FMC子母板的電源供應(yīng)和時(shí)鐘供應(yīng)功能、數(shù)據(jù)傳輸功能以及接口控制功能等。FPGA固件實(shí)現(xiàn)相關(guān)芯片配置、時(shí)鐘信號管理、復(fù)位信號管理、數(shù)字下變頻、數(shù)據(jù)緩存和傳輸?shù)裙δ?。由于FMC母板統(tǒng)一進(jìn)行電源供應(yīng),可以輸出3.3 V和1.8 V兩種電壓,因此,對于常規(guī)的數(shù)據(jù)采集設(shè)計(jì),ADC子板不需額外進(jìn)行電源電路設(shè)計(jì)。FMC母板上的時(shí)鐘合成電路用于合成光纖傳輸?shù)膮⒖紩r(shí)鐘,時(shí)鐘子板對兩個(gè)采樣子板的采樣時(shí)鐘進(jìn)行備份。通過FPGA配置,可以實(shí)現(xiàn)信號采樣、數(shù)據(jù)處理和光纖傳輸?shù)臅r(shí)鐘全相參。

FMC母板上可以裝載兩個(gè)ADC子板,本系統(tǒng)只用到其中一個(gè)。直接射頻采樣數(shù)字接收機(jī)的ADC子板設(shè)計(jì)在第3節(jié)詳細(xì)論述。

3 ADC子板設(shè)計(jì)

采用SHA+ADC架構(gòu)的直接射頻采樣數(shù)字接收機(jī)通過一個(gè)FMC的ADC子板來實(shí)現(xiàn),ADC子板的結(jié)構(gòu)框圖如圖3所示。

圖3 ADC子板的結(jié)構(gòu)框圖

從硬件上看,ADC子板可以分為數(shù)據(jù)通路和時(shí)鐘通路。數(shù)據(jù)通路描述射頻信號的處理流程。射頻信號通過ADC子板的SMA連接器進(jìn)入采樣保持器,經(jīng)過采樣和保持,輸出差分臺階信號,進(jìn)入相對低速的ADC進(jìn)行A/D變換,這樣便彌補(bǔ)了低速ADC芯片無法采樣高頻信號的不足。ADC芯片采用國家半導(dǎo)體公司的8位雙通道ADC——ADC08D1500。該芯片采樣率最高可達(dá)1.7 GS/s。雙通道ADC通過Time-Interleaved技術(shù),采樣率可以達(dá)到3 GS/s以上[8]。本設(shè)計(jì)中,雙通道ADC的采樣率均設(shè)置為1 GS/s,拼接后的采樣率為2 GS/s。

時(shí)鐘通路的功能是為數(shù)據(jù)采集子板的采樣保持器和ADC供應(yīng)時(shí)鐘。頻率合成器輸出兩路2 GHz的時(shí)鐘信號,一路作為采樣時(shí)鐘供給采樣保持器,另外一路送入分頻器。頻率合成器采用ADI公司的ADF4350,內(nèi)置VCO,輸出頻帶寬,可以覆蓋137.5～4 400 MHz[9]。該路時(shí)鐘經(jīng)過二分頻之后,進(jìn)入LMK01020芯片。該芯片可以產(chǎn)生可控時(shí)延,用于調(diào)整采樣點(diǎn)的位置。調(diào)整的基本原則是采樣時(shí)刻對應(yīng)輸入臺階信號的中間附近。經(jīng)過時(shí)延調(diào)整之后的1 GHz時(shí)鐘信號送入ADC模塊,作為ADC的采樣時(shí)鐘。

4 FPGA固件設(shè)計(jì)

本設(shè)計(jì)中的FPGA固件功能主要是時(shí)鐘管理、復(fù)位信號管理、ADC芯片配置、時(shí)延芯片配置、數(shù)據(jù)解串和數(shù)據(jù)整理[10]。在實(shí)際應(yīng)用中推廣時(shí),可以根據(jù)需求,增加數(shù)據(jù)傳輸和接口管理等功能,完成完整的固件開發(fā)。

另外,本設(shè)計(jì)采用Chipscope軟件抓取FPGA中的信號進(jìn)行實(shí)時(shí)查看,并可存取ADC數(shù)據(jù)到計(jì)算機(jī)進(jìn)行頻譜分析。

5 測試結(jié)果

設(shè)計(jì)完成后,用信號發(fā)生器輸入射頻信號,進(jìn)行數(shù)據(jù)采集,保存數(shù)據(jù),用MATLAB對ADC數(shù)據(jù)進(jìn)行頻譜分析。數(shù)據(jù)采集過程中,對頻率為0～18 GHz的射頻信號進(jìn)行了全面測試,本文中重點(diǎn)比較和分析頻率高于10 GHz的高頻信號。測試信號為點(diǎn)頻。依次輸入頻率為10.4 GHz、11.6 GHz、…、18.4 GHz,且幅度為8 d Bm的信號,用2 GS/s采樣率進(jìn)行采集。測試結(jié)果如表1所示。

表1 不同頻率射頻信號的信噪比測試結(jié)果

10.4 GHz射頻信號輸入時(shí)的頻譜響應(yīng)如圖4所示。

圖4 10.4 GHz射頻信號輸入的頻譜響應(yīng)

18.4 GHz射頻信號輸入時(shí)的頻譜響應(yīng)如圖5所示。

圖5 18.4 GHz射頻信號輸入的頻譜響應(yīng)

從表1可以看到,輸入信號為10.4 GHz時(shí),信噪比可以達(dá)到37.9 d B,信號頻率逐漸增加到18.4 GHz時(shí),信噪比也基本隨之下降。信號頻率小于15 GHz時(shí),信噪比基本在35 d B以上,對8位ADC芯片而言,可以滿足常規(guī)的數(shù)據(jù)采集設(shè)計(jì)需求。輸入信號頻率增加到15 GHz以上時(shí),信噪比下降劇烈。對比圖4和圖5,信號頻率為10.4 GHz時(shí),輸入信號功率約為-7.1 d Bm,而信號頻率為18.4 GHz時(shí),輸入信號功率下降到-19.8 dBm。因?yàn)樾盘栐磶捪拗?信號功率下降明顯,影響了信噪比的測試。由此,本設(shè)計(jì)實(shí)現(xiàn)了低速ADC對寬波段射頻信號的直接采樣。

需要說明的是,本文設(shè)計(jì)的數(shù)字接收機(jī)可以接受超寬帶的射頻信號輸入,但由于采樣保持器1821TH的最大采樣率為2 GS/s,因此,輸入射頻信號的帶寬不能超過1 GHz。

6 結(jié)束語

本系統(tǒng)采用高性能的采樣保持器,基于SHA+ADC的架構(gòu),設(shè)計(jì)了一種支持超寬帶信號輸入的數(shù)字接收機(jī),用低速ADC芯片實(shí)現(xiàn)了射頻信號的直接采樣。本文首先介紹了超寬帶數(shù)據(jù)采集系統(tǒng)的組成和工作原理,然后重點(diǎn)介紹了寬帶數(shù)據(jù)采集子板的硬件設(shè)計(jì),簡要介紹了FPGA的固件設(shè)計(jì)。測試結(jié)果顯示,輸入信號頻率增加到14.4 GHz時(shí),接收機(jī)信噪比仍可達(dá)到35 dB以上,可以滿足常規(guī)數(shù)字接收機(jī)的系統(tǒng)需求,具有一定的應(yīng)用價(jià)值。

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[2]楊小牛,樓才義,徐建良.軟件無線電原理與應(yīng)用[M].北京:電子工業(yè)出版社,2001:28-31.

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