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        基于IEEE1149.4標(biāo)準(zhǔn)的參數(shù)測試系統(tǒng)的設(shè)計(jì)

        2013-08-22 08:02:40何淑珍
        科技視界 2013年9期
        關(guān)鍵詞:測試方法總線電容

        凌 云 何淑珍

        (湖南工學(xué)院,湖南 衡陽 421002)

        隨著集成電路的高速發(fā)展,聯(lián)合行動測試組(JTAG)提出了邊界掃描測試技術(shù),形成了IEEE1149.1邊界掃描測試標(biāo)準(zhǔn)[1]以及IEEE1149.4混合信號電路邊界掃描測試總線標(biāo)準(zhǔn)[2],為電路測試提供了很好的解決方案。

        目前許多基于IEEE1149.4標(biāo)準(zhǔn)的電路測試系統(tǒng)設(shè)計(jì)均采用單片機(jī)作為主控制器[3-4]??紤]到FPGA較強(qiáng)的靈活性與可擴(kuò)展性,本文使用FPGA作為電路參數(shù)測試的主控制器,設(shè)計(jì)一個電路參數(shù)測試系統(tǒng)。實(shí)驗(yàn)表明,該系統(tǒng)設(shè)計(jì)合理,能對被測板進(jìn)行參數(shù)測試。

        1 IEEE 1149.4標(biāo)準(zhǔn)簡介

        IEEE1149.4標(biāo)準(zhǔn)是對IEEE1149.1標(biāo)準(zhǔn)的擴(kuò)充,保持了IEEE1149.1標(biāo)準(zhǔn)中的測試存取口(TAP)以及數(shù)字邊界模塊(DBM),增添了對模擬電路參數(shù)測試的模擬測試存取口(ATAP:由AT1與AT2兩根線構(gòu)成)、測試總線接口電路(TBIC)、模擬邊界模塊(ABM)以及兩根內(nèi)部模擬測試總線(AB1、AB2)[5]。

        AT1與AT2構(gòu)成了模擬虛擬探針,測試激勵由AT1進(jìn)入,由AB1發(fā)送到核心電路或通過一個引腳到達(dá)外部電路,測試響應(yīng)經(jīng)由AB2傳送至AT2輸出。

        2 參數(shù)測試方法

        系統(tǒng)通過邊界掃描測試總線(TMS、TCK、TDI、TDO)對被測電路施加測試向量,控制被測板中符合IEEE1149.4標(biāo)準(zhǔn)的芯片的測試總線接口電路(TBIC)和模擬邊界模塊(ABM)的開關(guān)矩陣,完成混合電路邊界掃描測試鏈路的配置,形成的虛擬探針通路。通過向虛擬探針AT1施加直流或交流激勵、AT2讀回測試響應(yīng),便可計(jì)算出電阻的阻值或電容的容值。參數(shù)測試方法如圖1所示。

        圖1 參數(shù)測試方法Fig.1 The method of parametric test

        其中,US為模擬電壓激勵值,U為響應(yīng)電壓值,f為正弦激勵的頻率,RS為已知的電阻,則待測電阻、電容的計(jì)算公式為:

        3 測試系統(tǒng)設(shè)計(jì)

        系統(tǒng)主要由邊界掃描控制器、USB通信模塊、激勵產(chǎn)生模塊和信號調(diào)理模塊和AD采樣模塊構(gòu)成,其結(jié)構(gòu)如圖1所示。

        圖2 系統(tǒng)硬件結(jié)構(gòu)圖Fig.2 Structure diagram of the hardware system

        4 系統(tǒng)測試驗(yàn)證

        以電容測試為例,測試一個容值為1μF的電容,RS阻值為1kΩ,交流激勵頻率為1kHz,采集10次響應(yīng)數(shù)據(jù)進(jìn)行平均,得出被測電容容值為1.028μF,測試誤差為2.8%。實(shí)驗(yàn)結(jié)果表明系統(tǒng)能夠完成參數(shù)測試,并且測試誤差較小。

        5 結(jié)論

        本文基于IEEE1149.4標(biāo)準(zhǔn)設(shè)計(jì)了一個用FPGA進(jìn)行控制的參數(shù)測試系統(tǒng),并對其功能進(jìn)行了驗(yàn)證,實(shí)驗(yàn)結(jié)果表明該系統(tǒng)測試方法簡單,測試過程迅速,測試結(jié)果準(zhǔn)確。該系統(tǒng)為混合電路測試提供了一個很好的解決方案,具有重要的應(yīng)用價(jià)值。

        [1]IEEE Std 1149.1—1990:IEEE Standard Test Access Port and Boundary-Scan Architecture[S].IEEE Computer Society,1990.

        [2]IEEE Std 1149.4—2010:IEEE Standard for a Mixed Signal Test Bus[S].IEEE Computer Society,2010.

        [3]Li Yan-ping,Le Jia.Design of Analog Test Hardware Platform Based on IEEE1149.4,The Ninth International Conference on Electronic Measurement&Instrument,2009.

        [4]張西多,易曉山,胡政.基于IEEE1149.4的混合信號邊界掃描測試控制器設(shè)計(jì)[J].自動化測試,2006,14(5).

        [5]陳圣儉,張勝滿,周燕,陳健.基于IEEE 1149.4標(biāo)準(zhǔn)的混合電路測試系統(tǒng)設(shè)計(jì)[J].計(jì)算機(jī)測量與控制,2009.17(9):1673-1675.

        [6]錢峰.EZ-USB FX2單片機(jī)原理、編程及應(yīng)用[M].北京:北京航空航天大學(xué)出版社,2006.

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