基于NVDLA與FPGA結(jié)合的神經(jīng)網(wǎng)絡(luò)加速器平臺設(shè)計(jì)
2021-07-16 07:20:30管兆康,張志偉
高技術(shù)通訊 2021年5期
關(guān)鍵詞：設(shè)計(jì)
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