【摘 要】本文采用了SMIC0.18 μm工藝,設(shè)計(jì)了一款應(yīng)用在2.4Ghz(藍(lán)牙系統(tǒng))的低噪聲放大器(LNA)。通過(guò)該實(shí)例,詳細(xì)介紹了設(shè)計(jì)CMOS低噪聲放大器的整個(gè)過(guò)程。文章先初步構(gòu)建了一個(gè)單端共源-共柵結(jié)構(gòu)放大電路,然后對(duì)該放大電路進(jìn)行了理論分析,最后采用射頻設(shè)計(jì)軟件ADS(Advanced Design System)對(duì)其進(jìn)行了模擬優(yōu)化,在2.4Ghz時(shí)獲得了1.443dB的噪聲系數(shù)(NF)。模擬結(jié)果表明本文設(shè)計(jì)的低噪聲放大器有噪聲低,增益高的優(yōu)點(diǎn),且匹配良好。
【關(guān)鍵詞】低噪聲放大器(LNA);CMOS;共源一共柵結(jié)構(gòu);ADS(Advanced Design System)
一、引言
低噪聲放大器(LNA)是廣泛應(yīng)用于微波通信、雷達(dá)、GPS接收機(jī),遙感遙控、藍(lán)牙等各種接收系統(tǒng)的關(guān)鍵部件,屬于射頻前端接收器,是必不可少的關(guān)鍵電路。其重要作用有兩方面,一方面是對(duì)天線所接收到的微弱信號(hào)進(jìn)行放大,另一方面是對(duì)該微弱信號(hào)進(jìn)行降噪處理。由于LNA的輸出信號(hào)會(huì)傳輸?shù)较乱患?jí)進(jìn)行處理,因此,LNA性能的好壞會(huì)大大影響到整個(gè)系統(tǒng)的性能。尤其是其噪聲系數(shù),是設(shè)計(jì)的關(guān)鍵所在,它的增益將決定對(duì)后級(jí)電路的噪聲抑制程度,它的線性度將對(duì)整個(gè)系統(tǒng)的線性度和共模噪聲抑制比產(chǎn)生重要影響。LNA的設(shè)計(jì)需要滿足以下要求:第一,應(yīng)該具有足夠高的增益及接收靈敏度;第二,應(yīng)該有足夠高的線性度,來(lái)抑止干擾和防止靈敏度下降;第三,端口應(yīng)當(dāng)匹配良好,信號(hào)能夠有效的傳輸,除此之外,還應(yīng)滿足有效隔離、防止信號(hào)泄漏以及穩(wěn)定性等方面的要求。一直以來(lái),由于CMOS器件的頻率特性較差,人們不得不采用GaAs或Bi-CMOS等工藝來(lái)實(shí)現(xiàn)LNA。而后端部分通常使用CMOS工藝,這樣就造成了兩種工藝的不兼容性,使得無(wú)線通信系統(tǒng)的片上集成十分困難。因此對(duì)工藝的統(tǒng)一十分重要,由于GaAs或Bi-CMOS等工藝并不適合后端的基帶部分,因此我們希望能夠改變LNA的工藝制造來(lái)提高兼容性。隨著CMOS工藝的發(fā)展,這個(gè)問(wèn)題慢慢得到了改善,在柵長(zhǎng)發(fā)展到低于0.1μm以后,Si-MOS器件的工作頻率也得到了大大的提高,截止頻率可達(dá)200GHz以上。這為基于CMOS工藝的LNA的制造創(chuàng)造了有利的條件。本文采用了SMIC0.18μm工藝,使用射頻設(shè)計(jì)軟件ADS(Advanced Design System)設(shè)計(jì)了一款高性能的低噪聲放大器,可以應(yīng)用于藍(lán)牙頻段的射頻前端。本設(shè)計(jì)的預(yù)期指標(biāo)為:中心頻率為2.4GHz,增益大于16dB,噪聲系數(shù)小于2dB,功耗小于10mW,采用1.5V電源供電。
二、電路結(jié)構(gòu)與理論分析
通常,低噪聲放大器主要由四個(gè)部分組成:輸入匹配電路,放大電路,偏置電路,輸出匹配電路。在本設(shè)計(jì)中較為核心的放大電路,采用了最為成熟穩(wěn)定的共源—共柵結(jié)構(gòu)。在該放大電路中,M1管為主放大管(共源管),提供足夠的增益。M2管(共柵管)用來(lái)減少M(fèi)1管的寄生電容所引起的密勒效應(yīng)及增強(qiáng)方向隔離性能,同時(shí)增大放大器的輸出阻抗。其中的Cin為隔直電容,L5,Lg用來(lái)實(shí)現(xiàn)輸入阻抗匹配。M3為M1提供鏡像電流,R2阻值設(shè)的足夠大,這樣可以避免高頻信號(hào)進(jìn)入偏置電路,還可以抑制偏置電路中的噪聲進(jìn)入核心電路。M2給放大器提供一個(gè)低阻抗負(fù)載,降低了Miller效應(yīng)的影響,同時(shí)還提高了反向隔離性。L,C1,C2可以很好的實(shí)現(xiàn)輸出匹配。
圖1 共源一共柵結(jié)構(gòu)的LNA電路結(jié)構(gòu)圖
在設(shè)計(jì)中,我們采用了SMIC0.18μm工藝,理論分析過(guò)程及設(shè)計(jì)思路如下:首先考慮噪聲晶體管M1最優(yōu)寬度W:W≈,式(1)。其中,C=,對(duì)于信號(hào)源電阻Rs,取值為50Ω,可以計(jì)算出W值。然后,合理選取M3和R1為M1提供合適的偏置電流,通常M3寬度為M1的1/10。由輸入阻抗Zin,可以確定Ls與L:Z=jω(L+L)++ωL,式(2)。其中ω≈,g=μmC(W/L)(V-V),C=2/3WLC由于輸入阻抗實(shí)部要求為50Ω,即ωL=50Ω,由此可以確定Ls的值。再由輸入阻抗虛部位為0,即ω(L+L)+=0,式(3),我們可以確定Lg的值。最后可以通過(guò)ADS進(jìn)行調(diào)試來(lái)選擇L,C1,C2,以實(shí)現(xiàn)輸出阻抗匹配。在此過(guò)程中,我們只需要得到各個(gè)參數(shù)的一個(gè)大概范圍即可,更加精確的值,我們可以通過(guò)ADS仿真得到。
三、ADS仿真驗(yàn)證
文章采用SMIC0.18μm工藝庫(kù),使用射頻設(shè)計(jì)軟件ADS對(duì)電路進(jìn)行了驗(yàn)證與優(yōu)化,在ADS中,完整的電路圖如圖2所示,其中的電路參數(shù)都是經(jīng)過(guò)優(yōu)化之后的結(jié)果。模擬結(jié)果現(xiàn)實(shí),該電路具有低噪聲,很好的匹配性及較高的增益等性能。
圖2 ADS優(yōu)化后電路結(jié)構(gòu)圖
在調(diào)試過(guò)程中,應(yīng)該按照先局部后整體優(yōu)化進(jìn)行。局部電路是指前面所說(shuō)的LNA的四個(gè)子電路,即輸入匹配電路,放大電路,偏置電路和輸出匹配電路。在調(diào)試時(shí),我們可以先對(duì)這個(gè)四個(gè)模塊分別進(jìn)行優(yōu)化,在對(duì)整體的電路進(jìn)行優(yōu)化,得到最終的優(yōu)值。圖3是該電路噪聲性能模擬結(jié)果,由圖3可以看出,在2.4Ghz工作頻率下,噪聲系數(shù)NF為1.443dB,最小噪聲系數(shù)出現(xiàn)在2.1Ghz附近,大小為0.8dB,表明該電路具有良好的噪聲性能。該性能遠(yuǎn)好于基于0.35μmGe-Si的BiCMOS的結(jié)果,也接近于TSMC0.13μmCMOS工藝的結(jié)果。足以滿足我們的設(shè)計(jì)指標(biāo),且留有一定容差。
圖3 噪聲系數(shù)模擬結(jié)果
圖4~圖6分別是S21,S11,S22指標(biāo)的模擬結(jié)果。首先看S21,S21即為電路的增益系數(shù),由圖4可以看到,設(shè)計(jì)的LNA在大約2.4Ghz時(shí)達(dá)到了峰值22.695dB,也超出了我們的設(shè)計(jì)要求,這個(gè)值也大于參考文獻(xiàn)[4]所獲得的結(jié)果。從圖5和圖6中,我們可以看到S11,S22分別為-23.651dB和-19.895dB,都遠(yuǎn)小于-10dB,可見(jiàn)輸入輸出回波損耗很小,匹配良好。
圖4 S21模擬結(jié)果 圖5 S11模擬結(jié)果
圖6 S22模擬結(jié)果
此外,該電路采用了1.5V電源供電,經(jīng)計(jì)算,功耗較小,約為7.5mW。
四、結(jié)論
本文采用SMIC0.18μm工藝標(biāo)準(zhǔn),設(shè)計(jì)了一種適用于射頻藍(lán)牙系統(tǒng)(2.4Ghz)的CMOS低噪聲放大器,使用ADS進(jìn)行了仿真優(yōu)化。模擬表明,在2.4Ghz工作頻率下,噪聲系數(shù)NF為1.443dB,增益S21達(dá)到了22.695dB,S11和S22分別為-23
651dB和-19.895dB,實(shí)現(xiàn)了良好的匹配。此外,采用1.5V供電的系統(tǒng)功耗為7.5mW,這些指標(biāo)表明,該電路具有低噪聲,低功耗,高增益的優(yōu)勢(shì),完全可以滿足藍(lán)牙系統(tǒng)的要求。
參 考 文 獻(xiàn)
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