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        低成本多路輸出CMOS帶隙基準(zhǔn)電壓源設(shè)計(jì)

        2012-04-12 00:00:00蔡元張濤
        現(xiàn)代電子技術(shù) 2012年16期

        摘要:在傳統(tǒng)Brokaw帶隙基準(zhǔn)源的基礎(chǔ)上,提出一種采用自偏置結(jié)構(gòu)和共源共柵電流鏡的低成本多路基準(zhǔn)電壓輸出的CMOS帶隙基準(zhǔn)源結(jié)構(gòu),省去了一個放大器,并減小了所需的電阻阻值,大大降低了成本,減小了功耗和噪聲。該設(shè)計(jì)基于華虹1 μm的CMOS工藝,進(jìn)行了設(shè)計(jì)與仿真實(shí)現(xiàn)。Cadence仿真結(jié)果表明,在-40~140 ℃的溫度范圍內(nèi),溫度系數(shù)為23.6 ppm/℃,靜態(tài)電流為24 μA,并且能夠產(chǎn)生精確的3 V,2 V,1 V和0.15 V基準(zhǔn)電壓,啟動速度快,能夠滿足大多數(shù)開關(guān)電源的設(shè)計(jì)需求與應(yīng)用。

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