摘 要：在簡要介紹BF533 DSP開發(fā)平臺的基礎(chǔ)上，著重描述如何對BF533的PPI，DMA等硬件資源進(jìn)行配置，以及如何將解碼器輸出的YUV數(shù)據(jù)按照ITU-R 656幀格式配置成幀后傳送到監(jiān)視器進(jìn)行顯示，實現(xiàn)H.264解碼器輸出的視頻播放。測試結(jié)果表明，視頻顯示播放可以達(dá)到實時要求，完成了一個基于低功耗DSP的實時H.264解碼器系統(tǒng)，為移動和無線視頻的接收終端的實現(xiàn)打下良好的基礎(chǔ)。

關(guān)鍵詞：H.264；DSP；ITU-R656；視頻解碼；視頻顯示

中圖分類號：TN919.8 文獻(xiàn)標(biāo)識碼：B 文章編號：1004-373X(2008)06-050-03[HJ1*5]

Display of H.264 Decoded Video Based on Blackfin DSP

ZHANG Diankai，GAN Zongliang，ZHU Xiuchang

(College of Communications and Information Engineering，Nanjing University of Posts and Telecommunications，Nanjing，210003，China)[HJ1*5]

Abstract：This paper introduces the resources configuration and architecture of BF533 platform and addresses the principle of H.264 decoder briefly.Then we configure the hardware resources(PPI，DMA etc.) and deliver the video data which is configured by ITU-656 format to display on monitor realizing the display of video-out ofH.264 decoder.The results oftest demonstrate the video display can meet the real-time demand and complete the H.264 decoder system which is based on low power consumption DSP，and then lay the foundation for realization of mobile and wireless terminate.

Keywords：H.264；DSP；ITU-R656；video decoder；video display[HJ1*2]

1 Blackfin533 DSP平臺簡介

Blackfin533 是美國模擬器件公司(ADI)開發(fā)的一款高性能視頻處理芯片，其主頻高達(dá)600 MHz，每秒可處理1 200 M次乘加運(yùn)算，具有大量針對視頻的專用指令，可以并行處理多條指令，這些特性使得該DSP芯片能處理廣泛用于互聯(lián)網(wǎng)的大量圖像﹑聲音﹑文本和數(shù)據(jù)流，適用于通信和各種互聯(lián)網(wǎng)設(shè)備。Blackfin DSP開發(fā)平臺如圖1所示：

開發(fā)平臺的中心處理器Blackfin533是一種單核、加載/存儲結(jié)構(gòu)的DSP，擁有雙MAC以及正交RISC微處理指令集。除此之外，Blackfin533還具有以下特點：雙40 b算法邏輯單元(ALU)；一個40 b的移位器；4個視頻ALU；一個8通道的32 b數(shù)據(jù)寄存器；148 kB的片內(nèi)存儲器(16 kB可作為指令CACHE，32 kB可作為數(shù)據(jù)CACHE)；動態(tài)電源管理功能等。另外，在Blackfin533的存儲器結(jié)構(gòu)中，DMA 控制器提供高帶寬數(shù)據(jù)轉(zhuǎn)移，能夠完成L1/L2 存儲器和外部存儲器之間編碼或數(shù)據(jù)塊轉(zhuǎn)移，并且高速緩沖存儲器可以設(shè)置，以便處理器和DMA可獨立地訪問。此開發(fā)平臺的外設(shè)中有ADV7171視頻編碼器(用于視頻顯示)和ADV7183視頻解碼器(用于視頻采集)。其中ADV7171可提供3種模擬視頻輸出方式，而ADV7183可提供3個模擬視頻的輸入通道。視頻編碼器連接到PPI1口，解碼器連接到PPI0口，每個PPI口都有其獨立的時鐘信號。

2 H.264解碼顯示的設(shè)計模塊

H.264解碼器的視頻顯示采用PPI口的DMA操作，他將緩沖區(qū)中的視頻數(shù)據(jù)傳輸?shù)紸DV進(jìn)行數(shù)/模轉(zhuǎn)換后到監(jiān)視器進(jìn)行顯示播放，其中BF533的PPI口支持ITU-R656的3種輸入模式和1種輸出模式。

2.1 ITU-R 656簡介

BF533處理器支持ITU-R 656的并行數(shù)字視頻輸出，對8 b和10 b精度的數(shù)字視頻都支持，圖2和圖3分別給出了輸出模式下NTSC/PAL制式顯示的行結(jié)構(gòu)和幀結(jié)構(gòu)，只要按照這個結(jié)構(gòu)配置幀緩沖區(qū)就可以實現(xiàn)視頻顯示。

在這種輸出模式下，水平標(biāo)志位H、垂直標(biāo)志位V和場標(biāo)志位F(如圖3所示)都插入到視頻數(shù)據(jù)中進(jìn)行傳送，不需要單獨傳送。活動視頻開始標(biāo)志(SAV)和結(jié)束標(biāo)志(EAV)表示視頻數(shù)據(jù)讀入的開始和結(jié)束，SAV發(fā)生在H的1-to-0的轉(zhuǎn)變，EAV發(fā)生在H的0-to-1轉(zhuǎn)變。完整的視頻場(field)應(yīng)包含視頻的水平掃描消隱和和以及垂直掃描消隱信號。隔行掃描的視頻由奇場和偶場組成，兩場的掃描行呈交插關(guān)系，逐行掃描視頻則沒有奇偶場的區(qū)別。

如圖2所示，EAV和SAV標(biāo)志有3個已定義的字節(jié)(0xFF，0x00，0x00)，緊跟著是XY狀態(tài)字，XY狀態(tài)字除了F，V，H位外，包含4個保護(hù)位(P0～P4)來進(jìn)行單個位錯誤檢測和修正。注意F和V僅可以作為EAV序列的一部分來改變(即H從而變到1)。標(biāo)志位的定義如下：

F=0，奇數(shù)場，F(xiàn)=1，偶數(shù)場；V=0，垂直消隱，V=1，活動視頻；H=0，SAV，H=1，EAV；P3=V xor H，P2=F xor H，P1=F xor V，P0=F xor V xor H。

其中各個標(biāo)志位在8 b和10b情況下的定義如表1所示。開發(fā)平臺的處理器接口能適應(yīng)不同長度的行和場。一般來說，只要引入的視頻有合適的EAV和SAV標(biāo)志，PPI就可以讀入。一個CIF圖像可以被轉(zhuǎn)換格式以適應(yīng)ITU-R656幀格式的要求，其中EAV和SAV定義了每個數(shù)據(jù)流的圖像排列，V和F標(biāo)志可以用來限定場和幀。

ITU-R 656輸出模式下通過PPI口從內(nèi)存中輸出數(shù)據(jù)和標(biāo)志字節(jié)，數(shù)據(jù)和控制標(biāo)志必須在輸出前在內(nèi)存的幀緩沖區(qū)中放置好。本文中采用的監(jiān)視器顯示制式為NTSC，根據(jù)圖2和圖3可知每行為1 716 B，每幀為525行，因此開辟的幀緩沖區(qū)大小應(yīng)為1 716×525。視頻顯示流程圖如圖2所示。

2.2 相關(guān)寄存器的配置

H.264解碼視頻顯示涉及到的硬件相關(guān)寄存器配置主要有：PLL的初始化、中斷寄存器的配置、DMA、PPI、ADV、FALSH等有關(guān)寄存器進(jìn)行配置。其中DMA傳送可以是基于描述符的，也可以是基于自動緩沖的。在2種方式下都需要對各個寄存器進(jìn)行相應(yīng)的配置。

2.3 H.264解碼顯示的實現(xiàn)

本文的H.264解碼器的軟件模塊的設(shè)計主要是面向DSP硬件實現(xiàn)。從NAL層的比特流經(jīng)逆量化和反變換后根據(jù)幀內(nèi)或幀間預(yù)測模式進(jìn)行相應(yīng)的還原得到解碼重構(gòu)幀，對重構(gòu)幀的YUV數(shù)據(jù)進(jìn)行視頻顯示。

將H.264解碼器輸出的YUV數(shù)據(jù)暫存到SDRAM中，然后插值為ITU-R656格式數(shù)據(jù)存儲到以frame_buffer為首地址的幀緩沖區(qū)中相應(yīng)的位置，在加上合適的控制信號字節(jié)，完成ITU-R656一幀數(shù)據(jù)的初始化，用DMA傳輸幀緩沖區(qū)中的數(shù)據(jù)到PPI端口經(jīng)ADV數(shù)模變換后到監(jiān)視器顯示播放?？驁D如圖5所示。

其中DMA傳輸分別采用了自動緩沖方式和描述符方式。在自動緩沖方式下實現(xiàn)圖像的動態(tài)輸出，可以在DMA中斷時按照單幀顯示的方法不斷將YUV數(shù)據(jù)寫入幀緩沖區(qū)，這樣對同一塊緩沖區(qū)邊讀邊寫的方式使得緩沖區(qū)的數(shù)據(jù)產(chǎn)生了沖突，在兩幀圖像的顯示之間有不定的圖像，而且從計算機(jī)中讀取數(shù)據(jù)的效率不高導(dǎo)致顯示延時較大，圖像顯示不連續(xù)，因此要加以改進(jìn)。在描述符方式下開辟一塊連續(xù)N個緩沖區(qū)，一起讀入數(shù)N幀數(shù)據(jù)，把這N個緩沖區(qū)全部初始化為單幀顯示的形式。

然后DMA將這N幀數(shù)據(jù)連續(xù)傳送來實現(xiàn)了圖像的動態(tài)顯示。但由于硬件的內(nèi)部資源有限，所讀入的數(shù)據(jù)幀數(shù)N也是有限的。為了克服存儲器資源的限制，在描述符方式下實現(xiàn)多幀圖像的顯示，采用“乒乓”機(jī)制來實現(xiàn)邊寫邊顯示?！捌古摇睓C(jī)制的實現(xiàn)方法如下：

typedef struct _vout_frame {

volatile unsigned char *data；

int flag；

} vout_frame；

其中data是幀緩沖區(qū)的起始地址；flag為幀緩沖區(qū)寫操作完成的標(biāo)志。定義類型為結(jié)構(gòu)體vout_frame的2個幀緩沖區(qū)buffer[2]，對緩沖區(qū)進(jìn)行寫操作，如果完成就置標(biāo)志位flag為1，表示幀緩沖區(qū)寫操作完成，每次中斷產(chǎn)生時就檢測這個非顯示的幀緩沖區(qū)的標(biāo)志位 flag，如果為0，就無操作；如果為1，就把DMA描述符的傳送地址改為這個幀緩沖區(qū)的起始地址，同時把剛才使用的那個幀緩沖區(qū)的標(biāo)志位flag置0。例如當(dāng)幀緩沖區(qū)1寫操作完成，則置buffer[0].flag=1，當(dāng)中斷產(chǎn)生時檢測到這個幀緩沖區(qū)的標(biāo)志位為1，則把DMA描述符的傳送地址修改為這個幀緩沖區(qū)的起始地址buffer[0].data，就可以讀取這個幀緩沖區(qū)中的數(shù)據(jù)進(jìn)行顯示，然后對幀緩沖區(qū)2進(jìn)行寫操作，如此循環(huán)。這樣在任意時刻，兩個緩沖區(qū)都有一個處于寫操作狀態(tài)，一個處于讀操作狀態(tài)，互不干擾，實現(xiàn)了視頻的顯示播放。

3 實驗結(jié)果

圖6所示顯示為claire和mobile序列YUV數(shù)據(jù)在DMA以自動緩沖方式、描述符方式傳輸數(shù)據(jù)時，播放在監(jiān)視器屏幕上的截圖：x

從圖6可以看出，DMA在兩種傳輸數(shù)據(jù)方式下，在顯示單幀圖像時沒什么區(qū)別，但是在動態(tài)顯示時，自動緩沖方式不能改變傳送的幀緩沖區(qū)的地址，而描述符方式在中斷完成時可以修改DMA傳輸?shù)牡刂罚瑢崿F(xiàn)“乒乓”機(jī)制，因此動態(tài)顯示時應(yīng)采用描述符方式傳送數(shù)據(jù)。

4 結(jié) 語

本文是在BF533開發(fā)平臺上實現(xiàn)H.264解碼器的視頻顯示播放，完善一個基于低功耗DSP的實時H.264解碼器系統(tǒng)，為完成移動和無線視頻的接收終端的實現(xiàn)打下良好的基礎(chǔ)。調(diào)試結(jié)果表明，已基本滿足H.264實時解碼顯示的要求，具有較好的應(yīng)用意義。但是本文的主要程序大都是用C語言編寫的，沒有進(jìn)行DSP硬件語言優(yōu)化，運(yùn)行效率不是很高，下一階段將對程序代碼進(jìn)行優(yōu)化。

參考文獻(xiàn)

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[8]林福宗.多媒體技術(shù)基礎(chǔ)\\[M\\].北京：清華大學(xué)出版社，2002.

作者簡介 張殿凱 男，1983年出生，黑龍江嫩江人。南京郵電大學(xué)碩士。研究方向為圖像處理和多媒體通信。

干宗良 男，1979年出生，新疆石河子人。南京郵電大學(xué)博士。主要研究方向為分布視頻編碼，視頻編碼DSP實現(xiàn)。

朱秀昌 男，1947年出生，江蘇丹徒人。南京郵電大學(xué)通信與信息工程學(xué)院副院長，教授，博導(dǎo)。江蘇省圖像處理與圖像通信重點實驗室主任。